Low-power CMOS threshold-logic gate

Avedillo, MJ ; Quintana, JM; Rueda, A; Jimenez, E

Tipo: Artículo
Año de Publicación: 1995
Volumen: 31
Número: 25
Páginas: 2157 - 2159
Fuente Nº Citas Fecha Actualización
scopus4216-10-2021
wos3516-10-2021
Dimensions
PlumX
Altmetric

Año (SCIE): 1997

Factor de Impacto (SCIE): 1.005

CategoríaEdiciónPosiciónCuartilTercilDecil
ENGINEERING, ELECTRICAL & ELECTRONICSCIE33/193Q1T1D2

SJR año:

1999

Factor de Impacto:

1.511

CategoríaPosiciónCuartilTercilDecil
Electrical and Electronic Engineering23/418Q1T1D1
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# Autor Afiliación
1Avedillo, MJ Universidad de Sevilla (Spain)
2Quintana, JMUniversidad de Sevilla (Spain)
3Rueda, AUniversidad de Sevilla (Spain)
4Jimenez, EUniversidad de Sevilla (Spain)