Comparison of TFETs and CMOS using optimal design points for power-speed tradeoffs

Núñez, Juan ; Avedillo, María J.

Tipo: Artículo
Año de Publicación: 2017
Volumen: 16
Número: 1
Número de artículo: 7744669
Páginas: 83 - 89
Acceso abierto: Vía verde
Fuente Nº Citas Fecha Actualización
scopus1524-09-2022
wos1224-09-2022
Dimensions
PlumX
Altmetric

Año: 2017

Journal Impact Factor (JIF): 2.857

CategoríaEdiciónPosiciónCuartilTercilDecil
ENGINEERING, ELECTRICAL & ELECTRONICSCIE72/260Q2T1D3
PHYSICS, APPLIEDSCIE42/146Q2T1D3
MATERIALS SCIENCE, MULTIDISCIPLINARYSCIE92/285Q2T1D4
NANOSCIENCE & NANOTECHNOLOGYSCIE48/92Q3T2D6

Año: 2017

Journal Citation Indicator (JCI): 0,720

CategoríaPosiciónCuartilTercilDecilPercentil
ENGINEERING, ELECTRICAL & ELECTRONIC131/306Q2T2D557,35
MATERIALS SCIENCE, MULTIDISCIPLINARY110/343Q2T1D468,08
NANOSCIENCE & NANOTECHNOLOGY48/116Q2T2D559,05
PHYSICS, APPLIED54/165Q2T1D467,58

Año:

2017

CiteScore:

5.000

CategoríaPosiciónCuartilTercilDecil
Computer Science Applications100/569Q1T1D2
Electrical and Electronic Engineering101/666Q1T1D2

SJR año:

2017

Factor de Impacto:

0.572

CategoríaPosiciónCuartilTercilDecil
Electrical and Electronic Engineering161/626Q2T1D3
Computer Science Applications200/539Q2T2D4
Nanoscience and Nanotechnology38/88Q2T2D5
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Agencia Código de Proyecto
FEDERTEC2013-40670-P
Ministerio de Economia y Competitividad del Gobierno de Espana-
Nota: los datos sobre financiación provienen de la WOS
# Autor Afiliación
1Núñez, Juan Universidad de Sevilla (Spain)
2Avedillo, María J.Universidad de Sevilla (Spain)