Experimental and timing analysis comparison of FPGA trivium implementations and their vulnerability to clock fault injection

Potestad Ordóñez, Francisco Eugenio; Jiménez Fernández, Carlos Jesús ; Valencia Barrero, Manuel

Tipo: Ponencia
Año de Publicación: 2017
Páginas: 43 - 48
Fuente Nº Citas Fecha Actualización
scopus427-11-2021
wos127-11-2021
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PlumX
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# Autor Afiliación
1Potestad Ordóñez, Francisco EugenioUniversidad de Sevilla (Spain)
2Jiménez Fernández, Carlos Jesús Universidad de Sevilla (Spain)
3Valencia Barrero, ManuelUniversidad de Sevilla (Spain)